drm/shared-core/nv50_graph.c

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 */

#include "drmP.h"
#include "drm.h"
#include "nouveau_drv.h"

#define IS_G80 ((dev_priv->chipset & 0xf0) == 0x50)

static void
nv50_graph_init_reset(struct drm_device *dev)
{
	struct drm_nouveau_private *dev_priv = dev->dev_private;
	uint32_t pmc_e = NV_PMC_ENABLE_PGRAPH | (1 << 21);

	DRM_DEBUG("\n");

	NV_WRITE(NV03_PMC_ENABLE, NV_READ(NV03_PMC_ENABLE) & ~pmc_e);
	NV_WRITE(NV03_PMC_ENABLE, NV_READ(NV03_PMC_ENABLE) |  pmc_e);
}

static void
nv50_graph_init_intr(struct drm_device *dev)
{
	struct drm_nouveau_private *dev_priv = dev->dev_private;

	DRM_DEBUG("\n");
	NV_WRITE(NV03_PGRAPH_INTR, 0xffffffff);
	NV_WRITE(0x400138, 0xffffffff);
	NV_WRITE(NV40_PGRAPH_INTR_EN, 0xffffffff);
}

static void
nv50_graph_init_regs__nv(struct drm_device *dev)
{
	struct drm_nouveau_private *dev_priv = dev->dev_private;

	DRM_DEBUG("\n");

	NV_WRITE(0x400804, 0xc0000000);
	NV_WRITE(0x406800, 0xc0000000);
	NV_WRITE(0x400c04, 0xc0000000);
	NV_WRITE(0x401804, 0xc0000000);
	NV_WRITE(0x405018, 0xc0000000);
	NV_WRITE(0x402000, 0xc0000000);

	NV_WRITE(0x400108, 0xffffffff);

	NV_WRITE(0x400824, 0x00004000);
	NV_WRITE(0x400500, 0x00010001);
}

static void
nv50_graph_init_regs(struct drm_device *dev)
{
	struct drm_nouveau_private *dev_priv = dev->dev_private;

	DRM_DEBUG("\n");

	NV_WRITE(NV04_PGRAPH_DEBUG_3, (1<<2) /* HW_CONTEXT_SWITCH_ENABLED */);
}

static uint32_t nv50_ctx_voodoo[] = {
	0x0070008e, 0x0070009c, 0x00200020, 0x00600008, 0x0050004c, 0x00400e89,
	0x00200000, 0x00600007, 0x00300000, 0x00c000ff, 0x00200000, 0x008000ff,
	0x00700009, 0x00417e4d, 0x00401e44, 0x00401e05, 0x00401e0d, 0x00415a06,
	0x00600005, 0x004015c5, 0x00600011, 0x00401c0b, 0x0090ffff, 0x0091ffff,
	0x00200020, 0x00600008, 0x0050004c, 0x00600009, 0x00415a45, 0x0041754d,
	0x0070009d, 0x004022cf, 0x0070009f, 0x0050009f, 0x00401fc0, 0x00200080,
	0x00600008, 0x00401f4f, 0x00401fc0, 0x004025cc, 0x00700081, 0x00200000,
	0x00600006, 0x00700000, 0x00111bfc, 0x00700080, 0x00700083, 0x00200047,
	0x00600006, 0x0011020a, 0x002005c0, 0x00600007, 0x00300000, 0x00c000ff,
	0x00c800ff, 0x00416507, 0x00202627, 0x008000ff, 0x00403c8c, 0x005000cb, 
	0x00a0023f, 0x00200040, 0x00600006, 0x0070000f, 0x00170202, 0x0011020a,
	0x00200032, 0x0010020d, 0x001b0242, 0x00120302, 0x00140402, 0x00180500,
	0x00130509, 0x00150550, 0x00110605, 0x001e0607, 0x00110700, 0x00110900,
	0x00110902, 0x00110a00, 0x00160b02, 0x00110b28, 0x00140b2b, 0x00110c01,
	0x00111400, 0x00111405, 0x00111407, 0x00111409, 0x0011140b, 0x002000ea,
	0x00101500, 0x0040640f, 0x0040644b, 0x00213700, 0x00600007, 0x00200440,
	0x008800ff, 0x0070008f, 0x0040648c, 0x005000cb, 0x00000000, 0x001118f8,
	0x0020002b, 0x00101a05, 0x00131c00, 0x00111c04, 0x00141c20, 0x00111c25,
	0x00131c40, 0x00111c44, 0x00141c60, 0x00111c65, 0x00131c80, 0x00111c84,
	0x00141ca0, 0x00111ca5, 0x00131cc0, 0x00111cc4, 0x00141ce0, 0x00111ce5,
	0x00131d00, 0x00111d04, 0x00141d20, 0x00111d25, 0x00131d40, 0x00111d44,
	0x00141d60, 0x00111d65, 0x00131f00, 0x00191f40, 0x00409ee0, 0x00200217,
	0x00600006, 0x00200044, 0x00102080, 0x001120c6, 0x001520c9, 0x001920d0,
	0x00122100, 0x00122103, 0x00162200, 0x0040960f, 0x0040964b, 0x00213700,
	0x00600007, 0x00200440, 0x008800ff, 0x0070008f, 0x0040968c, 0x005000cb,
	0x00000000, 0x00122207, 0x00112280, 0x00112300, 0x00112302, 0x00122380,
	0x0011238b, 0x00192394, 0x0040b0e1, 0x00200285, 0x00600006, 0x00200044,
	0x00102480, 0x001124c6, 0x001524c9, 0x001924d0, 0x00122500, 0x00122503,
	0x00162600, 0x00122607, 0x00112680, 0x00112700, 0x00112702, 0x00122780,
	0x0011278b, 0x00192794, 0x0040cce2, 0x002002f3, 0x00600006, 0x00200044,
	0x00102880, 0x001128c6, 0x001528c9, 0x0040c00f, 0x0040c04b, 0x00213700,
	0x00600007, 0x00200440, 0x008800ff, 0x0070008f, 0x0040c08c, 0x005000cb,
	0x00000000, 0x001928d0, 0x00122900, 0x00122903, 0x00162a00, 0x00122a07,
	0x00112a80, 0x00112b00, 0x00112b02, 0x00122b80, 0x00112b8b, 0x00192b94, 
	0x0040dee3, 0x00200361, 0x00600006, 0x00200044, 0x00102c80, 0x00112cc6,
	0x00152cc9, 0x00192cd0, 0x00122d00, 0x00122d03, 0x00162e00, 0x00122e07,
	0x00112e80, 0x00112f00, 0x00112f02, 0x00122f80, 0x00112f8b, 0x00192f94,
	0x0040fae4, 0x002003cf, 0x00600006, 0x00200044, 0x00103080, 0x0040ec0f,
	0x0040ec4b, 0x00213700, 0x00600007, 0x00200440, 0x008800ff, 0x0070008f, 
	0x0040ec8c, 0x005000cb, 0x00000000, 0x001130c6, 0x001530c9, 0x001930d0,
	0x00123100, 0x00123103, 0x00163200, 0x00123207, 0x00113280, 0x00113300,
	0x00113302, 0x00123380, 0x0011338b, 0x00193394, 0x00410ce5, 0x0020043d,
	0x00600006, 0x00200044, 0x00103480, 0x001134c6, 0x001534c9, 0x001934d0,
	0x00123500, 0x00123503, 0x00163600, 0x00123607, 0x00113680, 0x00113700,
	0x00113702, 0x00123780, 0x0011378b, 0x00193794, 0x004128e6, 0x002004ab,
	0x00600006, 0x00200044, 0x00103880, 0x00411a0f, 0x00411a4b, 0x00213700,
	0x00600007, 0x00200440, 0x008800ff, 0x0070008f, 0x00411a8c, 0x005000cb,
	0x00000000, 0x001138c6, 0x001538c9, 0x001938d0, 0x00123900, 0x00123903,
	0x00163a00, 0x00123a07, 0x00113a80, 0x00113b00, 0x00113b02, 0x00123b80,
	0x00113b8b, 0x00193b94, 0x00413ae7, 0x00200519, 0x00600006, 0x00200044,
	0x00103c80, 0x00113cc6, 0x00153cc9, 0x00193cd0, 0x00123d00, 0x00123d03,
	0x00163e00, 0x00123e07, 0x00113e80, 0x00113f00, 0x00113f02, 0x00123f80,
	0x00113f8b, 0x00193f94, 0x00000000, 0x0041410f, 0x005000cb, 0x00213700,
	0x00600007, 0x00200440, 0x008800ff, 0x005000cb, 0x00414487, 0x0060000a,
	0x00000000, 0x00415300, 0x007000a0, 0x00700080, 0x002005c0, 0x00600007,
	0x00200004, 0x00c000ff, 0x008000ff, 0x005000cb, 0x00700000, 0x00200000,
	0x00600006, 0x00111bfe, 0x0041754d, 0x00700000, 0x00200000, 0x00600006,
	0x00111bfe, 0x00700080, 0x0070001d, 0x0040114d, 0x00700081, 0x00600004,
	0x0050004a, 0x00415f88, 0x0060000b, 0x00200000, 0x00600006, 0x00700000,
	0x0041750b, 0x00111bfd, 0x00402e4d, 0x00202627, 0x008000fd, 0x005000cb,
	0x00c00002, 0x002005c0, 0x00600007, 0x0020015f, 0x00800002, 0x005000cb,
	0x00c01802, 0x002024c8, 0x00800002, 0x005000cb, 0x00403a4d, 0x0060000b,
	0x0041734d, 0x00700001, 0x00700003, 0x00417906, 0x00417a05, 0x0060000d,
	0x00700005, 0x0070000d, 0x00700006, 0x0070000b, 0x0070000e, 0x0070001c,
	0x0060000c, ~0
};

static uint32_t nv84_ctx_voodoo[] = {
	0x0070008e, 0x0070009c, 0x00200020, 0x00600008, 0x0050004c, 0x00400e89,
	0x00200000, 0x00600007, 0x00300000, 0x00c000ff, 0x00200000, 0x008000ff,
	0x00700009, 0x0041634d, 0x00402944, 0x00402905, 0x0040290d, 0x00413e06,
	0x00600005, 0x004015c5, 0x00600011, 0x0040270b, 0x004021c5, 0x00700000,
	0x00700081, 0x00600004, 0x0050004a, 0x00216f40, 0x00600007, 0x00c02801,
	0x0020002e, 0x00800001, 0x005000cb, 0x0090ffff, 0x0091ffff, 0x00200020,
	0x00600008, 0x0050004c, 0x00600009, 0x00413e45, 0x0041594d, 0x0070009d,
	0x00402dcf, 0x0070009f, 0x0050009f, 0x00402ac0, 0x00200200, 0x00600008,
	0x00402a4f, 0x00402ac0, 0x004030cc, 0x00700081, 0x00200000, 0x00600006,
	0x00700000, 0x00111bfc, 0x00700083, 0x00300000, 0x00216f40, 0x00600007,
	0x00c00b01, 0x0020001e, 0x00800001, 0x005000cb, 0x00c000ff, 0x00700080,
	0x00700083, 0x00200047, 0x00600006, 0x0011020a, 0x00200480, 0x00600007,
	0x00300000, 0x00c000ff, 0x00c800ff, 0x00414907, 0x00202916, 0x008000ff,
	0x0040508c, 0x005000cb, 0x00a0023f, 0x00200040, 0x00600006, 0x0070000f,
	0x00170202, 0x0011020a, 0x00200032, 0x0010020d, 0x001c0242, 0x00120302,
	0x00140402, 0x00180500, 0x00130509, 0x00150550, 0x00110605, 0x0020000f,
	0x00100607, 0x00110700, 0x00110900, 0x00120902, 0x00110a00, 0x00160b02,
	0x00120b28, 0x00140b2b, 0x00110c01, 0x00111400, 0x00111405, 0x00111407,
	0x00111409, 0x0011140b, 0x002000cb, 0x00101500, 0x0040790f, 0x0040794b,
	0x00214d40, 0x00600007, 0x0020043e, 0x008800ff, 0x0070008f, 0x0040798c,
	0x005000cb, 0x00000000, 0x0020002b, 0x00101a05, 0x00131c00, 0x00121c04,
	0x00141c20, 0x00111c25, 0x00131c40, 0x00121c44, 0x00141c60, 0x00111c65,
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	0x00800002, 0x005000CB, 0x00C01802, 0x00202C72, 0x00800002, 0x005000CB,
	0x00404E4D, 0x0060000B, 0x0041874D, 0x00700001, 0x00700003, 0x00418D06,
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	0x0070000E, 0x0070001C, 0x0060000C, ~0
};

static uint32_t nvaa_ctx_voodoo[] = {
	0x0070009c, 0x00300000, 0x0044f109, 0x00402d09, 0x0040e551, 0x00400a44,
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	0x00700097, 0x00450121, 0x004446a1, 0x0044764d, 0x0044824d, 0x0070001d,
	0x00401806, 0x00600005, 0x00444445, 0x0044308b, 0x00401845, 0x0040234d,
	0x00700081, 0x00401ccf, 0x0070009f, 0x0050009f, 0x0044dc4d, 0x00700017,
	0x0040230b, 0x00447d4d, 0x00450221, 0x004456a1, 0x007000a0, 0x00700001,
	0x00700003, 0x00402706, 0x00402805, 0x0060000d, 0x00700005, 0x0070000d,
	0x00700006, 0x00700002, 0x0070000b, 0x0070000e, 0x0070001c, 0x0060000c,
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	0x00700096, 0x00403acf, 0x0070009f, 0x0050009f, 0x0040e551, 0x004036c0,
	0x00200080, 0x00600008, 0x0040364f, 0x004036c0, 0x00403ecc, 0x00403651,
	0x00700016, 0x0048004d, 0x00600011, 0x0048004d, 0x0044364d, 0x0070008e,
	0x00700081, 0x0044704d, 0x00447d4d, 0x00700083, 0x00300000, 0x00212740,
	0x00600007, 0x00c00b01, 0x00200022, 0x00800001, 0x005000cb, 0x00c000ff,
	0x00445e4d, 0x0048004d, 0x0044ce08, 0x0044734d, 0x00448b4d, 0x00445e4d,
	0x0044e24d, 0x0044764d, 0x0044824d, 0x0048004d, 0x00700083, 0x0045034d,
	0x00a0023f, 0x00200040, 0x00600006, 0x0044fc4d, 0x00448d4d, 0x002001d0,
	0x0044b860, 0x00200280, 0x0038ffff, 0x0044cc4d, 0x00300000, 0x005000cb,
	0x00451c4d, 0x005000cb, 0x0044d007, 0x0048004d, 0x0044794d, 0x00111bfc,
	0x0048004d, 0x0044794d, 0x00111bfd, 0x0048004d, 0x0044794d, 0x00111bfe,
	0x0048004d, 0x00200000, 0x00700000, 0x00600006, 0x0048004d, 0x00200001,
	0x00600006, 0x0044fc4d, 0x0011020a, 0x0048004d, 0x00300000, 0x00c3ffff,
	0x00200000, 0x00600007, 0x00700000, 0x00200008, 0x008000ff, 0x005000cb,
	0x0048004d, 0x00000000, 0x0048004d, 0x00000000, 0x00170202, 0x00200032,
	0x0010020d, 0x001e0242, 0x001102c0, 0x00120302, 0x00150402, 0x00180500,
	0x00130509, 0x00150550, 0x00110605, 0x00200013, 0x00100607, 0x00110700,
	0x00110900, 0x00120902, 0x00110a00, 0x00160b02, 0x00120b28, 0x00140b2b,
	0x00110c01, 0x00110d01, 0x00111400, 0x00111405, 0x00111407, 0x00111409,
	0x0011140b, 0x002000d4, 0x00101500, 0x00141a05, 0x00131a0c, 0x00131c00,
	0x00131c04, 0x00141c20, 0x00131c25, 0x00131f00, 0x00131f04, 0x00111f08,
	0x00111f0b, 0x00200015, 0x00101f40, 0x0048004d, 0x00600006, 0x00451c4d,
	0x00112020, 0x00112022, 0x00200085, 0x00102040, 0x001120c8, 0x001420ca,
	0x001b20cf, 0x00122100, 0x00122103, 0x00162140, 0x00122147, 0x00122153,
	0x001121a0, 0x001221c0, 0x001121cb, 0x001121d4, 0x001521d8, 0x0048004d,
	0x00000000, 0x0048004d, 0x0060000b, 0x0048004d, 0x0060000a, 0x0048004d,
	0x0060000b, 0x0040d24d, 0x00200020, 0x00600008, 0x0050004c, 0x0048004d,
	0x002003e8, 0x00600008, 0x0050004c, 0x0048004d, 0x00600004, 0x0050004a,
	0x0048004d, 0x00c000ff, 0x00c800ff, 0x0048004d, 0x00c000ff, 0x00c800ff,
	0x0048004d, 0x00700016, 0x0070008e, 0x00700082, 0x00500041, 0x0044d84d,
	0x00700095, 0x005000d1, 0x00600016, 0x00500052, 0x00700002, 0x00700015,
	0x0040284d, 0x0070008e, 0x0044d44d, 0x00200000, 0x00600007, 0x00300000,
	0x00c000ff, 0x00200000, 0x008000ff, 0x00700009, 0x0070000e, 0x0048004d,
	0x00700080, 0x00480017, 0x00700000, 0x0048004d, 0x0048004d, 0x0048004d,
	0x0048004d, 0x0070008e, 0x0044d44d, 0x00700083, 0x0044df4d, 0x00450c4d,
	0x0070000f, 0x00410b8c, 0x005000cb, 0x0048004d, 0x00200280, 0x00600007,
	0x00452307, 0x00451187, 0x0048004d, 0x00000000, 0x00202070, 0x0044fc4d,
	0x008000ff, 0x0048004d, 0x00210600, 0x00600007, 0x00200428, 0x0044fc4d,
	0x008800ff, 0x0048004d, 0x0048000f, 0x0048004b, 0x0045164d, 0x0070008f,
	0x0048008c, 0x005000cb, 0x0048004d, 0x00202070, 0x0044fc4d, 0x008000fd,
	0x005000cb, 0x00c00002, 0x00200280, 0x00600007, 0x00200161, 0x0044fc4d,
	0x00800002, 0x005000cb, 0x00c00002, 0x00201f0e, 0x0044fc4d, 0x00800002,
	0x005000cb, 0x0048004d, ~0
};

static int
nv50_graph_init_ctxctl(struct drm_device *dev)
{
	struct drm_nouveau_private *dev_priv = dev->dev_private;
	uint32_t *voodoo = NULL;

	DRM_DEBUG("\n");

	switch (dev_priv->chipset) {
	case 0x50:
		voodoo = nv50_ctx_voodoo;
		break;
	case 0x84:
		voodoo = nv84_ctx_voodoo;
		break;
	case 0x86:
		voodoo = nv86_ctx_voodoo;
		break;
	case 0x92:
		voodoo = nv92_ctx_voodoo;
		break;
	case 0xaa:
		voodoo = nvaa_ctx_voodoo;
		break;
	default:
		DRM_ERROR("no voodoo for chipset NV%02x\n", dev_priv->chipset);
		return -EINVAL;
	}

	NV_WRITE(NV40_PGRAPH_CTXCTL_UCODE_INDEX, 0);
	while (*voodoo != ~0) {
		NV_WRITE(NV40_PGRAPH_CTXCTL_UCODE_DATA, *voodoo);
		voodoo++;
	}

	NV_WRITE(0x400320, 4);
	NV_WRITE(NV40_PGRAPH_CTXCTL_CUR, 0);
	NV_WRITE(NV20_PGRAPH_CHANNEL_CTX_POINTER, 0);

	return 0;
}

int
nv50_graph_init(struct drm_device *dev)
{
	int ret;

	DRM_DEBUG("\n");

	nv50_graph_init_reset(dev);
	nv50_graph_init_intr(dev);
	nv50_graph_init_regs__nv(dev);
	nv50_graph_init_regs(dev);

	ret = nv50_graph_init_ctxctl(dev);
	if (ret)
		return ret;

	return 0;
}

void
nv50_graph_takedown(struct drm_device *dev)
{
	DRM_DEBUG("\n");
}

static void
nv50_graph_init_ctxvals(struct drm_device *dev, struct nouveau_gpuobj_ref *ref)
{
	struct drm_nouveau_private *dev_priv = dev->dev_private;
	struct nouveau_gpuobj *ctx = ref->gpuobj;

	INSTANCE_WR(ctx, 0x0010c/4, 0x00000030);
	INSTANCE_WR(ctx, 0x00120/4, 0xff400040);
	INSTANCE_WR(ctx, 0x00124/4, 0xfff00080);
	INSTANCE_WR(ctx, 0x00128/4, 0xfff70090);
	INSTANCE_WR(ctx, 0x0012c/4, 0xffe806a8);
	INSTANCE_WR(ctx, 0x001d4/4, 0x00000003);
	INSTANCE_WR(ctx, 0x001d8/4, 0x00001000);
	INSTANCE_WR(ctx, 0x00214/4, 0x0000fe0c);
	INSTANCE_WR(ctx, 0x00228/4, 0x00001000);
	INSTANCE_WR(ctx, 0x00254/4, 0x0001fd87);
	INSTANCE_WR(ctx, 0x00268/4, 0x00001018);
	INSTANCE_WR(ctx, 0x0026c/4, 0x000000ff);
	INSTANCE_WR(ctx, 0x002a4/4, 0x00000004);
	INSTANCE_WR(ctx, 0x002a8/4, 0x0001005f);
	INSTANCE_WR(ctx, 0x002b0/4, 0x00000600);
	INSTANCE_WR(ctx, 0x002b4/4, 0x00000006);
	INSTANCE_WR(ctx, 0x002c8/4, 0x000000ff);
	INSTANCE_WR(ctx, 0x002d0/4, 0x00000400);
	INSTANCE_WR(ctx, 0x002e4/4, 0x00000001);
	INSTANCE_WR(ctx, 0x002e8/4, 0x00300080);
	INSTANCE_WR(ctx, 0x002ec/4, 0x00000004);
	INSTANCE_WR(ctx, 0x00308/4, 0x00000002);
	INSTANCE_WR(ctx, 0x0030c/4, 0x00000001);
	INSTANCE_WR(ctx, 0x00318/4, 0x00000001);
	INSTANCE_WR(ctx, 0x0031c/4, 0x00000100);
	INSTANCE_WR(ctx, 0x00334/4, 0x00000002);
	INSTANCE_WR(ctx, 0x00338/4, 0x00000001);
	INSTANCE_WR(ctx, 0x0033c/4, 0x00000001);
	INSTANCE_WR(ctx, 0x0034c/4, 0x00000001);
	INSTANCE_WR(ctx, 0x00350/4, 0x003fffff);
	INSTANCE_WR(ctx, 0x00354/4, 0x00001fff);
	INSTANCE_WR(ctx, 0x0035c/4, 0x00000001);
	INSTANCE_WR(ctx, 0x00360/4, 0x00000001);
	INSTANCE_WR(ctx, 0x00368/4, 0x00000001);
	INSTANCE_WR(ctx, 0x00368/4, 0x00000001);
	INSTANCE_WR(ctx, 0x00368/4, 0x00000001);
	INSTANCE_WR(ctx, 0x00368/4, 0x00000004);
	INSTANCE_WR(ctx, 0x00368/4, 0x00000001);
	INSTANCE_WR(ctx, 0x00368/4, 0x00000001);
	INSTANCE_WR(ctx, 0x00368/4, 0x00000001);
	INSTANCE_WR(ctx, 0x00368/4, 0x00000007);
	INSTANCE_WR(ctx, 0x00388/4, 0x00000001);
	INSTANCE_WR(ctx, 0x00388/4, 0x00000007);
	INSTANCE_WR(ctx, 0x00388/4, 0x00000001);
	INSTANCE_WR(ctx, 0x00388/4, 0x00000001);
	INSTANCE_WR(ctx, 0x00388/4, 0x00000001);
	INSTANCE_WR(ctx, 0x003ac/4, 0x00000001);
	INSTANCE_WR(ctx, 0x003b0/4, 0x00000001);
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}

static void
nv84_graph_init_ctxvals(struct drm_device *dev, struct nouveau_gpuobj_ref *ref)
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	struct drm_nouveau_private *dev_priv = dev->dev_private;
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}

static void
nv92_graph_init_ctxvals(struct drm_device *dev, struct nouveau_gpuobj_ref *ref)
{
	struct drm_nouveau_private *dev_priv = dev->dev_private;
	struct nouveau_gpuobj *ctx = ref->gpuobj;

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static void
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	INSTANCE_WR(ctx, 0x00edc/4, 0x00000001);
	INSTANCE_WR(ctx, 0x00efc/4, 0x08100c12);
	INSTANCE_WR(ctx, 0x00fdc/4, 0x000007ff);
	INSTANCE_WR(ctx, 0x00ffc/4, 0x00080c14);
	INSTANCE_WR(ctx, 0x0171c/4, 0x00000001);
	INSTANCE_WR(ctx, 0x0177c/4, 0x00000010);
	INSTANCE_WR(ctx, 0x01e9c/4, 0x00000088);
	INSTANCE_WR(ctx, 0x01ebc/4, 0x00000088);
	INSTANCE_WR(ctx, 0x01f1c/4, 0x00000004);
	INSTANCE_WR(ctx, 0x021fc/4, 0x00000026);
	INSTANCE_WR(ctx, 0x0225c/4, 0x3f800000);
	INSTANCE_WR(ctx, 0x022dc/4, 0x0000001a);
	INSTANCE_WR(ctx, 0x022fc/4, 0x00000010);
	INSTANCE_WR(ctx, 0x0281c/4, 0x00000052);
	INSTANCE_WR(ctx, 0x0285c/4, 0x00000026);
	INSTANCE_WR(ctx, 0x0289c/4, 0x00000004);
	INSTANCE_WR(ctx, 0x028bc/4, 0x00000004);
	INSTANCE_WR(ctx, 0x028fc/4, 0x0000001a);
	INSTANCE_WR(ctx, 0x0295c/4, 0x00ffff00);
	INSTANCE_WR(ctx, 0x41800/4, 0x08100c12);
	INSTANCE_WR(ctx, 0x41840/4, 0x00000080);
	INSTANCE_WR(ctx, 0x41860/4, 0x80007004);
	INSTANCE_WR(ctx, 0x41880/4, 0x04000400);
	INSTANCE_WR(ctx, 0x418a0/4, 0x000000c0);
	INSTANCE_WR(ctx, 0x418c0/4, 0x00001000);
	INSTANCE_WR(ctx, 0x41920/4, 0x00000e00);
	INSTANCE_WR(ctx, 0x41940/4, 0x00001e00);
	INSTANCE_WR(ctx, 0x41960/4, 0x00000001);
	INSTANCE_WR(ctx, 0x419c0/4, 0x00000001);
	INSTANCE_WR(ctx, 0x41a00/4, 0x00000004);
	INSTANCE_WR(ctx, 0x41a20/4, 0x00000002);
	INSTANCE_WR(ctx, 0x41ba0/4, 0x08100c12);
	INSTANCE_WR(ctx, 0x41be0/4, 0x0001fe21);
	INSTANCE_WR(ctx, 0x41ca0/4, 0x0000ffff);
	INSTANCE_WR(ctx, 0x41cc0/4, 0x0000ffff);
	INSTANCE_WR(ctx, 0x41ce0/4, 0x0000ffff);
	INSTANCE_WR(ctx, 0x41d00/4, 0x0000ffff);
	INSTANCE_WR(ctx, 0x41d20/4, 0x00000001);
	INSTANCE_WR(ctx, 0x41d40/4, 0x00010001);
	INSTANCE_WR(ctx, 0x41d60/4, 0x00010001);
	INSTANCE_WR(ctx, 0x41d80/4, 0x00000001);
	INSTANCE_WR(ctx, 0x41dc0/4, 0x0001fe21);
	INSTANCE_WR(ctx, 0x41e80/4, 0x08100c12);
	INSTANCE_WR(ctx, 0x41ea0/4, 0x00000004);
	INSTANCE_WR(ctx, 0x41ee0/4, 0x00000002);
	INSTANCE_WR(ctx, 0x41f00/4, 0x00000011);
	INSTANCE_WR(ctx, 0x42020/4, 0x0fac6881);
	INSTANCE_WR(ctx, 0x420c0/4, 0x00000004);
	INSTANCE_WR(ctx, 0x42200/4, 0x00000002);
	INSTANCE_WR(ctx, 0x42220/4, 0x00000001);
	INSTANCE_WR(ctx, 0x42240/4, 0x00000001);
	INSTANCE_WR(ctx, 0x42260/4, 0x00000002);
	INSTANCE_WR(ctx, 0x42280/4, 0x00000001);
	INSTANCE_WR(ctx, 0x422a0/4, 0x00000001);
	INSTANCE_WR(ctx, 0x422c0/4, 0x00000001);
	INSTANCE_WR(ctx, 0x42300/4, 0x00000004);
	INSTANCE_WR(ctx, 0x49700/4, 0x00000011);
	INSTANCE_WR(ctx, 0x49740/4, 0x00000001);
	INSTANCE_WR(ctx, 0x0012c/4, 0x00000002);
}

int
nv50_graph_create_context(struct nouveau_channel *chan)
{
	struct drm_device *dev = chan->dev;
	struct drm_nouveau_private *dev_priv = dev->dev_private;
	struct nouveau_gpuobj *ramin = chan->ramin->gpuobj;
	struct nouveau_engine *engine = &dev_priv->Engine;
	int grctx_size = 0x70000, hdr;
	int ret;

	DRM_DEBUG("ch%d\n", chan->id);

	ret = nouveau_gpuobj_new_ref(dev, chan, NULL, 0, grctx_size, 0x1000,
				     NVOBJ_FLAG_ZERO_ALLOC |
				     NVOBJ_FLAG_ZERO_FREE, &chan->ramin_grctx);
	if (ret)
		return ret;

	hdr = IS_G80 ? 0x200 : 0x20;
	INSTANCE_WR(ramin, (hdr + 0x00)/4, 0x00190002);
	INSTANCE_WR(ramin, (hdr + 0x04)/4, chan->ramin_grctx->instance +
					   grctx_size - 1);
	INSTANCE_WR(ramin, (hdr + 0x08)/4, chan->ramin_grctx->instance);
	INSTANCE_WR(ramin, (hdr + 0x0c)/4, 0);
	INSTANCE_WR(ramin, (hdr + 0x10)/4, 0);
	INSTANCE_WR(ramin, (hdr + 0x14)/4, 0x00010000);

	INSTANCE_WR(chan->ramin_grctx->gpuobj, 0x00000/4,
		    chan->ramin->instance >> 12);
	if (dev_priv->chipset == 0xaa)
		INSTANCE_WR(chan->ramin_grctx->gpuobj, 0x00004/4, 0x00000002);
	else
		INSTANCE_WR(chan->ramin_grctx->gpuobj, 0x0011c/4, 0x00000002);

	switch (dev_priv->chipset) {
	case 0x50:
		nv50_graph_init_ctxvals(dev, chan->ramin_grctx);
		break;
	case 0x84:
		nv84_graph_init_ctxvals(dev, chan->ramin_grctx);
		break;
	case 0x86:
		nv86_graph_init_ctxvals(dev, chan->ramin_grctx);
		break;
	case 0x92:
		nv92_graph_init_ctxvals(dev, chan->ramin_grctx);
		break;
	case 0xaa:
		nvaa_graph_init_ctxvals(dev, chan->ramin_grctx);
		break;
	default:
		/* This is complete crack, it accidently used to make at
		 * least some G8x cards work partially somehow, though there's
		 * no good reason why - and it stopped working as the rest
		 * of the code got off the drugs..
		 */
		ret = engine->graph.load_context(chan);
		if (ret) {
			DRM_ERROR("Error hacking up context: %d\n", ret);
			return ret;
		}
		break;
	}

	return 0;
}

void
nv50_graph_destroy_context(struct nouveau_channel *chan)
{
	struct drm_device *dev = chan->dev;
	struct drm_nouveau_private *dev_priv = dev->dev_private;
	int i, hdr;

	DRM_DEBUG("ch%d\n", chan->id);

	hdr = IS_G80 ? 0x200 : 0x20;
	for (i=hdr; i<hdr+24; i+=4)
		INSTANCE_WR(chan->ramin->gpuobj, i/4, 0);

	nouveau_gpuobj_ref_del(dev, &chan->ramin_grctx);
}

static int
nv50_graph_transfer_context(struct drm_device *dev, uint32_t inst, int save)
{
	struct drm_nouveau_private *dev_priv = dev->dev_private;
	uint32_t old_cp, tv = 20000;
	int i;

	DRM_DEBUG("inst=0x%08x, save=%d\n", inst, save);

	old_cp = NV_READ(NV20_PGRAPH_CHANNEL_CTX_POINTER);
	NV_WRITE(NV20_PGRAPH_CHANNEL_CTX_POINTER, inst);
	NV_WRITE(0x400824, NV_READ(0x400824) |
		 (save ? NV40_PGRAPH_CTXCTL_0310_XFER_SAVE :
			 NV40_PGRAPH_CTXCTL_0310_XFER_LOAD));
	NV_WRITE(NV40_PGRAPH_CTXCTL_0304, NV40_PGRAPH_CTXCTL_0304_XFER_CTX);

	for (i = 0; i < tv; i++) {
		if (NV_READ(NV40_PGRAPH_CTXCTL_030C) == 0)
			break;
	}
	NV_WRITE(NV20_PGRAPH_CHANNEL_CTX_POINTER, old_cp);

	if (i == tv) {
		DRM_ERROR("failed: inst=0x%08x save=%d\n", inst, save);
		DRM_ERROR("0x40030C = 0x%08x\n",
			  NV_READ(NV40_PGRAPH_CTXCTL_030C));
		return -EBUSY;
	}

	return 0;
}

int
nv50_graph_load_context(struct nouveau_channel *chan)
{
	struct drm_device *dev = chan->dev;
	struct drm_nouveau_private *dev_priv = dev->dev_private;
	uint32_t inst = chan->ramin->instance >> 12;
	int ret; (void)ret;

	DRM_DEBUG("ch%d\n", chan->id);

#if 0
	if ((ret = nv50_graph_transfer_context(dev, inst, 0)))
		return ret;
#endif

	NV_WRITE(NV20_PGRAPH_CHANNEL_CTX_POINTER, inst);
	NV_WRITE(0x400320, 4);
	NV_WRITE(NV40_PGRAPH_CTXCTL_CUR, inst | (1<<31));

	return 0;
}

int
nv50_graph_save_context(struct nouveau_channel *chan)
{
	struct drm_device *dev = chan->dev;
	uint32_t inst = chan->ramin->instance >> 12;

	DRM_DEBUG("ch%d\n", chan->id);

	return nv50_graph_transfer_context(dev, inst, 1);
}